迭代检测伪码捕获技术

第1章  扩频通信系统   
  1.1  概述
  1.2  扩频通信系统的基础知识
    1.2.1  扩频通信系统的概念
    1.2.2  扩频通信系统的基本原理
    1.2.3  扩频通信系统的类型
    1.2.4  扩频通信系统的基本参数
    1.2.5  扩频通信系统的特点
  1.3  伪随机序列
    1.3.1  伪随机序列的基本概念
    1.3.2  m序列
    1.3.3  gold码
    1.3.4  其他扩频序列
  1.4  同步原理 
    1.4.1  同步及其不确定性的来源
    1.4.2  捕获方法及性能分析
    1.4.3  跟踪原理及性能分析
第2章  迭代检测的基础知识
  2 1  概率的基础知识
    2.1.1  随机事件与样本空间 
    2.1.2  频率与概率 
    2.1.3  随机变量与随机过程
    2 1.4  全概率公式、贝叶斯法则和马尔可夫链 
    2.1.5  内在概率、外概率和后验概率
  2.2  信号检测与估计
    2.2.1  贝叶斯判决准则
    2.2.2  复合假设检验
    2.2.3  map-sqd与map-syd
    2.2.4  边缘与联合操作
  2.3  迭代检测思想来源——turho码
    2.3.1  信道编译码发展
    2.3.2  turbo码迭代检测的基本原理
  2.4  迭代检测相关知识和应用
    2.4.1  迭代检测算法的基本流程
    2.4.2  *佳迭代接收的条件
    2.4.3  迭代接收机的性能分析工具
    2.4.4  迭代检测的应用
第3章  因子图理论
  3.1  因子图的基础知识 
    3.1.1  因子图的基本概念
    3.1.2  因子图的应用
    3.1.3  因子图中消息传递策略
  3.2  基于图模型理论的和积算法
    3.2.1  计算一个边缘函数
    3.2.2  计算多个边缘函数
    3.2.3  因子图上和积算法的信息传递
  3.3  和积运算与*小和算法
    3.3.1  和积运算
    3.3.2  *小和算法
  3.4  基于因子图的迭代检测伪码捕获方法
    3.4.1  一般译码模型的建立
    3.4.2  迭代译码算法
    3.4.3  基于因子图的迭代检测伪码捕获方法
第4章  迭代检测伪码捕获方法  
  4.1  m序列迭代检测捕获算法
    4.1.1  基于和积算法的m序列捕获
    4.1.2  基于*小和算法的m序列捕获
    4.1.3  基于隐藏节点因子图的m序列捕获算法
    4 1.4  m序列迭代检测捕获算法性能仿真与分析
  4.2  g0ld码迭代检测捕获算法
    4.2.1  gold码校验关系的确定
    4.2.2  校验关系分析
    4 2.3  gold码的冗余校验捕获
    4.2.4  gold码的分层校验捕获
    4.2.5  gold码迭代捕获的仿真分析
  4.3  迭代检测伪码捕获方法的性能分析
    4.3.1  基于密度进化的收敛性分析
    4.3.2  基于exit图的收敛性分析
    4.3.3  本地码同步方法及其捕获性能分析
第5章  迭代检测伪码捕获方法的优化  
  5.1  基于迭代软信息的同步误差消除
    5.1.1  数字平均技术对初始码片信道信息的优化
    5.1.2  基于*大似然估计的码片定时误差消除
    5 1.3  基于三阶累积量的码片定时误差消除
  5.2  迭代检测捕获算法的复杂度分析与改进
    5.2 1  伪码迭代捕获算法的复杂度分析
    5.2.2  低存储复杂度迭代译码算法
    5.2.3  低运算复杂度向量选择算法 
  5.3  多用户m序列迭代检测捕获算法
    5 3.1  多用户联合初始信息进化方法
    5.3.2  多重迭代捕获算法
    5.3.3  多用户迭代捕获算法设计
第6章  迭代检测伪码捕获方法的fpga设计与实现  
  6.1  迭代检测伪码捕获方法的fpga架构
    6.1.1  算法功能模块的划分
    6.1.2  位宽设计
  6.2  控制通路设计
    6.2.1  主状态机设计
    6.2.2  信息初始化状态机设计
    6 2.3  前向递归状态机与后向递归状态机设计
  6.3  数据通路设计
    6.3.1  数据采集模块设计
    6.3.2  计算逻辑模块设计
    6.3.3  消息存储阵列设计
  6.4  恢复与判决单元设计
    6.4.1  捕获判决控制器设计
    6.4.2  伪码序列恢复模块设计
    6.4.3  门限判决模块设计 
  6.5  系统联调与测试结果
参考文献