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数字电路与FPGA设计(理工类地方本科院校新形态系列教材)

数字电路与FPGA设计(理工类地方本科院校新形态系列教材)

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图文详情
  • ISBN:9787305239885
  • 装帧:一般胶版纸
  • 册数:暂无
  • 重量:暂无
  • 开本:16开
  • 页数:226
  • 出版时间:2020-12-01
  • 条形码:9787305239885 ; 978-7-305-23988-5

内容简介

本书作为Digilent公司Basys 3 FPGA开发板的配套教材。Basys 3是一款可由Vivado工具链支持的入门级。FPGA开发板,带有Xilinx Artix-7 FPGA芯片架构。该款产品是广受欢迎的Basys系列HGA开发板中近期新的一代,特别适合刚开始接触FPGA技术的学生或初学者。教材以Xilinx公司近期新的Vivado集成开发环境和Verilog HDL语言展开,代码均可在Basys 3开发板上验证,充分体现实战性。 本书解决了从传统数字电路的理论体系到当前现代数字系统设计的转变,既保留了传统数字电路知识体系中重要的理论基础和典型74系列芯片的介绍,让读者明白在设计什么。更强调现代设计方法,突出模块化编程的思想和IP设计封装和调用方法。并且介绍了一些编程架构,比如计数器架构和状态机架构。注重方法论,不仅讲解知识点,更注重引导读者触类旁通,举一反三。 全书共8章,内容丰富、循序渐进,适合于刚刚接触FPGA的初学者自学阅读,又可作为各类院校电气信息类专业的数字电子技术、FPGA设计、EDA等课程的教材或参考书。

目录

章 数字逻辑基础
1.1 模拟信号和数字信号
1.2 二进制数、逻辑电平和数字波形
1.3 进制及进制之间的转换
1.4 逻辑代数的基本定律
1.5 逻辑代数的基本规则
1.6 逻辑函数的化简
1.7 卡诺图化简
本章习题
第2章 FPGA与Vivado基础
2.1 可编程器件基础
2.2 现场可编程门阵列(FPGA)
2.3 Basys 3 FPGA开发板资源
2.4 Vivado设计流程
本章习题
第3章 Verilog HDL基础
3.1 Verilog概述
3.2 Verilog基础知识
3.3 Verilog程序框架
3.4 Verilog编程规范
本章习题
第4章 组合逻辑电路设计基础
4.1 若干典型的组合逻辑集成电路
4.2 组合电路中的always块
4.3 条件语句
4.4 循环语句
4.5 always块的一般编码原则
4.6 常数和参数
4.7 设计实例
本章习题
第5章 时序电路设计基础
5.1 锁存器
5.2 触发器
5.3 寄存器
5.4 移位寄存器
5.5 计数器
5.6 设计实例
本章习题
第6章 计数器架构
6.1 计数器架构八步法
6.2 计数器项目实践
本章习题
第7章 状态机架构
7.1 有限状态机
7.2 有限状态机代码实现
7.3 设计实例
本章习题
第8章 数字积木设计模式
8.1 IP基础
8.2 打包属于自己的IP
8.3 源代码法调用IP核设计实例——多数表决器
8.4 原理图法调用IP核设计实例——二进制转格雷码
本章习题
参考文献
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作者简介

陈景波,常熟理工学院电气与自动化工程学院副教授、副院长,主要承担《数字电子技术》《数字电路与FPGA设计》《单片机原理与接口技术》等课程。教学成果及科研情况:出版教材《51单片机实战指南》,2019年;获得江苏省教学成果奖二等奖,2017年;获中国自动化学会高等教育教学成果奖二等奖,2019年;获常熟理工学院教学成果奖特等奖2项,一等奖2项;获江苏省科技进步奖三等奖1项。

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