AMD FPGA设计优化宝典:面向VIVADO/SYSTEMVERILOG

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作者：高亚军

出版社：电子工业出版社

本类榜单：工业技术

分类：工业技术 > 电子通信

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图文详情

ISBN：9787121457258
装帧：一般胶版纸
册数：暂无
重量：暂无
开本：其他
页数：440
出版时间：2023-06-01
条形码：9787121457258 ; 978-7-121-45725-8

本书特色

内容全面：既阐述了FPGA内部结构，又阐述了RTL代码风格(采用SystemVerilog语言)方法多样：既介绍了以Vivado图形界面为主的分析手段，又介绍了以Tcl脚本为主的分析手段学练结合：章后列出常见问题(全书共100个)，以便读者思考和练习468张图片，76个表格，186个SystemVerilog代码片段，56个Tcl脚本片段，57条设计规则，29个应用案例

内容简介

本书以Xilinx公司 7系列FPGA、UltraScale/UltraScale+和Versal ACAP内部架构为基础，介绍了与之匹配的RTL代码风格（采用SytemVerilog语言）和基于Vivado的设计分析方法。全书共10章内容，包括了时钟网络、组合逻辑、触发器、移位寄存器、存储器、乘加运算单元和状态机的代码风格和优化方法，也包含扇出和布线拥塞的优化方法。本书可供电子工程领域内的本科高年级学生和研究生学习参考，也可供FPGA工程师和自学者参考使用。

第1 章 FPGA 技术分析/ 1 1.1 芯片架构的演变 / 1 1.2 设计方法的演变 / 15 1.3 面临的挑战 / 20 1.4 四大基本原则 / 23 1.5 性能指标 / 29 1.6 思考空间 / 31 第2 章优化时钟网络/33 2.1 时钟资源 / 33 2.2 时钟偏移 / 55 2.3 时钟抖动 / 68 2.4 安全的时钟启动方式 / 75 2.5 时钟规划 / 79 2.6 创建输出时钟 / 84 2.7 思考空间 / 84 第3 章优化组合逻辑/86 3.1 组合逻辑资源 / 86 3.2 译码器代码风格 / 87 3.3 编码器代码风格 / 94 3.4 多路复用器代码风格 / 103 3.5 多路解复用器代码风格 / 116 3.6 比较器代码风格 / 118 3.7 移位器代码风格 / 130 3.8 加法器代码风格 / 135 3.9 奇偶校验电路代码风格 / 163 3.10 二进制码与格雷码互转电路代码风格 / 165 3.11 避免组合逻辑环路 / 168 3.12 慎用full_case 和parallel_case / 169 3.13 思考空间 / 175 第4 章优化触发器/ 176 4.1 触发器资源 / 176 4.2 建立时间和保持时间 / 183 4.3 亚稳态 / 185 4.4 控制集 / 188 4.5 复位信号的代码风格 / 194 4.6 同步边沿检测电路代码风格 / 204 4.7 串并互转电路代码风格 / 206 4.8 避免意外生成的锁存器 / 211 4.9 思考空间 / 216 第5 章优化移位寄存器/ / 218 5.1 移位寄存器资源 / 218 5.2 移位寄存器的代码风格 / 222 5.3 移位寄存器的应用场景 / 234 5.4 管理时序路径上的移位寄存器 / 236 5.5 思考空间 / 240 第6 章优化存储器/ 242 6.1 存储器资源 / 242 6.2 单端口RAM 代码风格 / 255 6.3 简单双端口RAM 代码风格 / 269 6.4 真双端口RAM 代码风格 / 277 6.5 RAM 的初始化与ROM 代码风格 / 284

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作者简介

高亚军，FPGA 技术分享者、设计优化和时序收敛专家、Vivado 工具使用专家、数字信号处理专家，现任Xilinx 资深战略应用工程师。多年来一直使用Xilinx FPGA 实现数字信号处理算法，对Xilinx FPGA 器件架构、开发工具Vivado、Vitis HLS 和Vitis ModelComposer 及设计理念有深厚的理论基础和实战经验。主要著作：2011 年出版《基于FPGA 的数字信号处理》；2012 年发布网络视频课程《Vivado 入门与提高》；2015 年出版《基于FPGA 的数字信号处理（第2 版）》；2016 年出版《Vivado 从此开始（基础篇）》；2016 年发布网络视频课程《跟Xilinx SAE 学HLS》；2020 年出版《Vivado 从此开始（进阶篇）》；2021 年出版《Vivado/Tcl 零基础入门与案例实战》。2018 年创建FPGA 技术分享公众号“FPGA 技术驿站”。每周更新一篇原创文章，累计发表原创文章380 余篇，获得大量粉丝的认可和称赞。

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